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A Low-Power Content-Adressable-Memory Based on Clustered-Sparse-Networks

H. Jarollahi, V. Gripon, N. Onizawa et W. J. Gross, "A Low-Power Content-Adressable-Memory Based on Clustered-Sparse-Networks," dans Proceedings of 24th International Conference on Application-specific Systems, Architectures and Processors, pp. 642--653, juin 2013.

Une Content-Adressable-Memory (CAM) utilisant un mécanisme nouveau pour associer les données d'entrée aux adresses correspondantes est introduite. L'architecture proposée s'appuie sur des réseaux de neurones binaires compartimentés récemment introduits qui éliminent en moyenne la plupart des comparaisons requises pendant la recherche. De fait, la consommation énergétique du modèle proposé est bien plus faible que celle d'une CAM conventionnelle. Étant donné une entrée, l'arichitecture identifie une poignée de lignes possibles dans une CAM associée et ne réalise les comparaisons que sur celles-ci. En utilisant une technologie CMOS 0.13 um, la consommation énergétique et le temps de réponse sont respectivement 9.5% et 30.4% de ceux d'une architecture NAND classique, pour un surcoût en nombre de transistors de 3.4%.

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Bibtex
@inproceedings{JarGriOniGro20136,
  author = {Hooman Jarollahi and Vincent Gripon and
Naoya Onizawa and Warren J. Gross},
  title = {A Low-Power Content-Adressable-Memory Based
on Clustered-Sparse-Networks},
  booktitle = {Proceedings of 24th International
Conference on Application-specific Systems,
Architectures and Processors},
  year = {2013},
  pages = {642--653},
  month = {June},
}




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